边缘计算_问答_易百纳技术社区-AI视觉聚合服务平台

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边缘计算

主题685

边缘计算起源于传媒领域，是指在靠近物或数据源头的一侧，采用网络、计算、存储、应用核心能力为一体的开放平台，就近提供最近端服务。其应用程序在边缘侧发起，产生更快的网络服务响应，满足行业在实时业务、应用智能、安全与隐私保护等方面的基本需求。

云计算节点大数据 AR VR MEC FPGA GPU DPDK Virtio

如何知道开发板的flsh的大小和型号
Xilinx FPGA

flyman46 发布于2019年01月18日
firstpic 回复于2019-01-18 15:26:03

2 3.1k
下载sdsoc报错，无法解决怎么办？
Xilinx FPGA

aaronliu 发布于2019年01月18日

0 2.5k
请问大家用什么 FMC 的扩展板？
Xilinx FPGA

机遇发布于2019年01月18日

0 2.4k
zynq里面半精度浮点关键字是什么？
Xilinx FPGA

qq1002513 发布于2019年01月18日

0 2.3k
请问如何下载预编译好的ubuntu根文件系统？
Xilinx FPGA

y130103 发布于2019年01月16日

0 2.9k
有谁在zynq上做计算机视觉方面的吗？
Xilinx FPGA

rcerk 发布于2019年01月16日

0 2.3k
移植完系统，插回开发板出现这种情况怎么办？
Xilinx FPGA

wwmo 发布于2019年01月16日

0 2.2k
xilinx zcu102 板上 74.25M和125M两个时钟是作什么用的？
Xilinx FPGA

beegeen 发布于2019年01月15日
RCMG 回复于2019-01-15 17:34:34

8 3.3k
执行petslinux-build时出错怎么解决？
Xilinx FPGA

wwwd2 发布于2019年01月15日

0 2.6k
有人在安装petalinux的时候遇到过这个问题吗？
Xilinx FPGA

黄老麦发布于2019年01月15日

0 2.8k
有没有哪位大侠搞过7z015的SFP模块的？
Xilinx FPGA

srici_yb 发布于2019年01月15日

0 2.3k
请问一下dma中断是由什么信号引起的？
Xilinx FPGA

zzzzzx 发布于2019年01月15日
288HK 回复于2019-01-15 17:10:18

9 2.8k
使用petalinix创建工程的时候，内核源码在哪里？
Xilinx FPGA

banxianyue 发布于2019年01月15日
donger205 回复于2019-01-15 16:42:47

1 2.4k
在verilog修改内部slv_reg的值，但是在sdk中读不出来是怎么回事？
Xilinx FPGA

chenbin 发布于2019年01月15日

0 2.3k
SDK写c程序时想调用lwip141协议栈，但只有lwip202怎么办？
Xilinx FPGA

飞鸟发布于2019年01月15日

0 3.2k
想问一下大家运行vivado都用的什么配置的电脑？
Xilinx FPGA

salem83 发布于2019年01月13日
JXEV 回复于2019-01-13 10:58:43

3 7.3k
安装vavido出现这个怎么回事？
Xilinx FPGA

LighBlade 发布于2019年01月13日
LighBlade 回复于2019-01-13 10:56:15

7 3k
请问怎么用ps 访问pl的印脚？
Xilinx FPGA

qyp1647 发布于2019年01月13日
Jako 回复于2019-01-13 10:49:39

2 2.6k
ZYNQ7020的板子在电路图上找不到PL端的clock端口怎么回事？
Xilinx FPGA

yinfei103 发布于2019年01月13日
dglgq 回复于2019-01-13 10:48:20

2 2.4k
有没有比较合适的 FPGA 开发板子推荐？
Xilinx FPGA

Laken 发布于2019年01月13日

0 2.4k
在官网下载SDsoc，总是下载一会就连接失败了怎么办？
Xilinx FPGA

地狱天使sw 发布于2019年01月13日
地狱天使sw 回复于2019-01-13 10:41:56

2 2.5k
在AMP模式下，cpu1的中断无法响应。怎么办？
Xilinx FPGA

podaxwenh 发布于2019年01月11日
podaxwenh 回复于2019-01-11 15:50:38

10 4.3k
vivado2017.4版本是不是不支持modelsim10.4版本啊？
Xilinx FPGA

mk-999 发布于2019年01月11日

0 3.4k
我在sdk里面建完工程，为什么找不到这两个头文件？
Xilinx FPGA

清风听雨发布于2019年01月11日
mfjsxz 回复于2019-01-11 15:17:10

1 2.8k
在ping网络的时候，这边的路由器上识别不到IP地址怎么办？
Xilinx FPGA

ww0705 发布于2019年01月11日

0 2.4k
有谁在VERILOG当中用for,while语句吗？
Xilinx FPGA

stander7 发布于2019年01月11日
stander7 回复于2019-01-11 14:52:59

2 2.5k
Debussy可以与64位的Modelsim一起联合仿真吗？
Xilinx FPGA

nosmoking 发布于2019年01月11日

0 2.2k
请问谁用FTDI的芯片配置过JTAG？
Xilinx FPGA

反恐精英发布于2019年01月11日

0 2.3k
再运行，debug core就没信号了，这怎么解决啊？
Xilinx FPGA

288HK 发布于2019年01月11日

0 2.3k
PYNQ Jupiter上编写的Python程序保存在哪里？
Xilinx FPGA

小林发布于2019年01月10日

0 2.8k
有人用zynq系列做过加速器的实验吗？
Xilinx FPGA

Alexia 发布于2019年01月10日

0 2.3k
大佬们，有人搞过这个 M1 核的吗？
Xilinx FPGA

zgdhappy 发布于2019年01月08日

0 2.1k
有没有NVMe转PCIE的硬件设计相关资料？
Xilinx FPGA

地狱天使sw 发布于2019年01月08日
0WFA3 回复于2019-01-08 16:10:28

2 2.6k
这里的1.8V能不能变成3.3V，以太网、USB、SD卡的IO也都变成3.3V，可以不？
Xilinx FPGA

wangzt 发布于2019年01月08日
wangzt 回复于2019-01-08 16:07:56

3 2.4k
大家好，请问有人用过AXI DMA的吗？
Xilinx FPGA

xiangrilia 发布于2019年01月08日

0 3.1k
求问，状态机的状态量采不到的情况有吗？
Xilinx FPGA

general 发布于2019年01月08日
general 回复于2019-01-08 15:37:33

2 2.4k
请问有人做过对CPLD外部晶振检测的逻辑吗？
Xilinx FPGA

sunack 发布于2019年01月08日
sunack 回复于2019-01-08 15:36:13

1 2.3k
请问Vivado 装过2017的版本后还可以装2014的么？
Xilinx FPGA

xiwenxian 发布于2019年01月07日
xiwenxian 回复于2019-01-07 15:34:47

2 2.6k
使用microBlaze软核，代码和数据区是放在哪里呢？
Xilinx FPGA

天天压马路发布于2019年01月07日

0 2.2k
从哪里可以看编译多少了？比如百分比
Xilinx FPGA

JXEV 发布于2019年01月07日
JXEV 回复于2019-01-07 15:30:14

2 2.4k

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