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sailshadow  发布于  2018-12-17 16:59:15
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ALTREA 的cpld，型号是EPM240，用的编译环境是Quartus，编程方式是原理图方式。现...

Xilinx
 
FPGA
 
ALTREA 的cpld，型号是EPM240，用的编译环境是Quartus，编程方式是原理图方式。现在有两种情况会出现两种错误：1是加上几个与非门就出现错误，2是去掉两个空的引脚就运行错误，这种情况大概是什么导致的？
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efool 2018-12-17 16:59:40
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提示什么错误呢？
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sailshadow 2018-12-17 17:00:21
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[quote][url=forum.php?mod=redirect&goto=findpost&pid=116494&ptid=55238]efool 发表于 2018-12-17 16:59[/url]
提示什么错误呢？[/quote]

没提示错误，只是下载进去之后运行有问题，现在资源用到82%了
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efool 2018-12-17 17:01:41
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[quote][url=forum.php?mod=redirect&goto=findpost&pid=116495&ptid=55238]sailshadow 发表于 2018-12-17 17:00[/url]
没提示错误，只是下载进去之后运行有问题，现在资源用到82%了[/quote]

嗯，资源使用多的情况下，应该做后时序仿真验证。做合理的时序约束
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