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明熙  发布于  2018-12-05 16:32:00
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开发板与FPGA通过srio通信例程

ST
 
开发板与FPGA通过srio通信例程中，输入时钟250M是从何而来，我看书上说是主pll经过3分频而来，对吗？但是我的主频是1G，3分频也不是这么多啊？
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