goo635
goo635

goo635

0个粉丝

17

问答

0

专栏

2

资料

goo635  发布于  2016-07-20 11:25:55
采纳率 0%
共17个问答
3331
  • 收藏
  • 点赞
  • 分享
  • 举报

雄迈的3531板卡 VI0 和VI4

海思
 
雄迈的3531板卡NVP6124  8通道 960H摄像头，其他通道都正常，VI0和VI4 乱七八糟的 帧率不对，这是什么情况？通过官方应用排除物理原因。
[VIU] Version: [Hi3531_MPP_V1.0.D.0 ], Build Time: [Feb  6 2015, 20:22:46]

-----MODULE PARAM--------------------------------------------------------------
detect_err_frame drop_err_frame stop_int_level  max_cas_gap
               1              0              0        28000

-----VI DEV ATTR---------------------------------------------------------------
Dev   IntfM  WkM  ComMsk0  ComMsk1 ScanM AD0 AD1 AD2 AD3   Seq   DPath DType DRev
   0   BT656 1Mux ff000000        0     I  -1  -1  -1  -1  UYVY  ByPass   YUV    N
   1   BT656 1Mux   ff0000        0     I  -1  -1  -1  -1  UYVY  ByPass   YUV    N
   2   BT656 1Mux     ff00        0     I  -1  -1  -1  -1  UYVY  ByPass   YUV    N
   3   BT656 1Mux       ff        0     I  -1  -1  -1  -1  UYVY  ByPass   YUV    N
   4   BT656 1Mux ff000000        0     I  -1  -1  -1  -1  UYVY  ByPass   YUV    N
   5   BT656 1Mux   ff0000        0     I  -1  -1  -1  -1  UYVY  ByPass   YUV    N
   6   BT656 1Mux     ff00        0     I  -1  -1  -1  -1  UYVY  ByPass   YUV    N
   7   BT656 1Mux       ff        0     I  -1  -1  -1  -1  UYVY  ByPass   YUV    N

-----VI HIGH DEV ATTR---------------------------------------------------------------
Dev  InputM  WkM  ComMsk0  ComMsk1 ScanM AD0 AD1 AD2 AD3   Seq CombM CompM ClkM  Fix FldP   DPath DType DRev

-----VI PHYCHN ATTR------------------------------------------------------------
PhyChn CapX CapY  CapW  CapH  DstW  DstH CapSel Mirror Flip IntEn PixFom SrcRat DstRat
      0    0    0   960   576   960   576   both      N    N     Y  sp420     25     25
      2    0    0   960   576   960   576   both      N    N     Y  sp422     25     25
      4    0    0   960   576   960   576   both      N    N     Y  sp420     25     25
      6    0    0   960   576   960   576   both      N    N     Y  sp422     25     25
      8    0    0   960   576   960   576   both      N    N     Y  sp420     25     25
     10    0    0   960   576   960   576   both      N    N     Y  sp422     25     25
     12    0    0   960   576   960   576   both      N    N     Y  sp420     25     25
     14    0    0   960   576   960   576   both      N    N     Y  sp422     25     25

-----VI PHYCHN STATUS 1----------------------------------------------------------
PhyChn  Dev      IntCnt  VbFail  LosInt  TopLos  BotLos BufCnt  IntT  SendT  Field  Stride
      0    0        3352       0     100       1      12      1    75     64   intl     960
      2    1        3233       0      40       0       1      2    13     50   intl     960
      4    2       14775       0     932      87     765      1    13      7   intl     960
      6    3        3191       0       3       0       2      1   106     97   intl     960
      8    4        3252       0       3       0       2      1    99     86   intl     960
     10    5        3251       0       1       0       1      1    48     40   intl     960
     12    6        3223       0       2       0       2      1   151    141   intl     960
     14    7        3212       0       2       0       2      2    17     45   intl     960

-----VI PHYCHN STATUS 2---------------------------------------------------------
PhyChn MaxIntT IntGapT MaxGapT OverCnt LIntCnt  ThrCnt AutoDis CasAutD  TmgErr      ccErrN    IntRat
      0     141   19968  220088       3       0      68       0       0       0        5410        25
      2     108   20030   20151       0       0       1       0       0       0        4892        25
      4     167      12  293109       2       0    2449       0       0       0       24192     15625
      6     195   19967  131063       2       0       1       0       0       0           3        25
      8     221   19972  220085       2       0       1       0       0       0           3        24
     10     109   19966   20166       0       0       1       0       0       0           1        25
     12     206   19970   20132       0       0       1       0       0       0           2        25
     14     145   20036   78894       1       0       1       0       0       0           2        25

-----VI PHYCHN VBI ATTR---------------------------------------------------------
PhyChn   VbiId       X       Y   Local     Len CasErrN

-----VI CASCADE CHN ATTR---------------------------------------------------------
CasChn    Dev  PhyChn  SrcRat  DstRat

-----VI CHN STATUS-------------------------------------------------------------
ViChn   bEnUsrP   FrmTime   FrmRate     SendCnt      SwLost    Rotate  422to420
     0         N     39999        27        3263           0      NONE         N
     2         N     39997        24        3192           0      NONE         Y
     4         N        64       122       14609           0      NONE         N
     6         N     39987        24        3189           0      NONE         Y
     8         N     40007        25        3250           0      NONE         N
    10         N     39998        25        3250           0      NONE         Y
    12         N     40000        25        3222           0      NONE         N
    14         N     39999        25        3210           0      NONE         Y

-----VI CHN CALL DSU STATUS 1-------------------------------------------------
ViChn   UsrBgnNOk   UsrCancel    UsrEndOk     UsrCbOk     CvrBgnNOk   CvrCancel    CvrEndOk     CvrCbOk

-----VI CHN CALL DSU STATUS 2-------------------------------------------------
ViChn   OsdBgnNOk   OsdCancel    OsdEndOk     OsdCbOk      ScaleNOk   SclCancel    SclEndOk     SclCbOk

-----VI CHN CALL DSU STATUS 3-------------------------------------------------
ViChn   RotateNOk   RotCancel    RotEndOk     RotCbOk        LDCNOk   LDCCancel    LDCEndOk     LDCCbOk
我来回答
回答7个
时间排序
认可量排序
david

david

41个粉丝

368

问答

253

专栏

229

资料

david 2016-07-20 15:33:04
认可0
6124 驱动，可能有问题
ngswfx

ngswfx

2个粉丝

55

问答

1

专栏

40

资料

ngswfx 2016-07-20 16:01:03
认可0
本帖最后由 ngswfx 于 2016-7-20 16:06 编辑

VI0和VI4

好有特点呀，应该是6124芯片第一通道。



//////////log里面的PhyChn以及ViChn 怎么都是偶数的。还超过8了，总共16个通道？ 还是有子码流通道？
goo635

goo635

0个粉丝

17

问答

0

专栏

2

资料

goo635 2016-07-20 20:59:49
认可0
[quote][url=forum.php?mod=redirect&goto=findpost&pid=34389&ptid=12020]ngswfx 发表于 2016-7-20 16:01[/url]
VI0和VI4

好有特点呀，应该是6124芯片第一通道。
[/quote]

子码通道，VI0 VI4 对应的dev是0和2，板卡上的第3个和第7个bnc口，肯定不是一个VIU
goodman

goodman

4个粉丝

30

问答

18

专栏

17

资料

goodman 2016-07-20 21:09:19
认可0
pin脚复用对吗？load3531脚本里面要检查下
goo635

goo635

0个粉丝

17

问答

0

专栏

2

资料

goo635 2016-07-21 06:17:59
认可0
[quote][url=forum.php?mod=redirect&goto=findpost&pid=34433&ptid=12020]goodman 发表于 2016-7-20 21:09[/url]
pin脚复用对吗？load3531脚本里面要检查下[/quote]

static void gpio_mode_conf(void)
{
    reg_write32(IO_CONFIG_REG(0), 0); //VIU0_CLK, GPIO0_0, VOU0_CLK
    reg_write32(IO_CONFIG_REG(1), 1); //VIU0_VS, GPIO0_1, UART2_TXD
    reg_write32(IO_CONFIG_REG(2), 3); //VIU0_HS, GPIO0_2, VOU1_CLK, VIU0_CLKA
    reg_write32(IO_CONFIG_REG(3), 0); //VIU0_DAT15, GPIO0_3, VOU0_DATA7
    reg_write32(IO_CONFIG_REG(4), 0); //VIU0_DAT14, GPIO0_4, VOU0_DATA6
    reg_write32(IO_CONFIG_REG(5), 0); //VIU0_DAT13, GPIO0_5, VOU0_DATA5
    reg_write32(IO_CONFIG_REG(6), 0); //VIU0_DAT12, GPIO0_6, VOU0_DATA4
    reg_write32(IO_CONFIG_REG(7), 0); //VIU0_DAT11, GPIO0_7, VOU0_DATA3
    reg_write32(IO_CONFIG_REG(8), 0); //VIU0_DAT10, GPIO1_0, VOU0_DATA2
    reg_write32(IO_CONFIG_REG(9), 0); //VIU0_DAT9, GPIO1_1, VOU0_DATA1
    reg_write32(IO_CONFIG_REG(10), 0); //VIU0_DAT8, GPIO1_2, VOU0_DATA0
    reg_write32(IO_CONFIG_REG(11), 0); //VIU0_DAT7, GPIO1_3, VOU1_DATA7
    reg_write32(IO_CONFIG_REG(12), 0); //VIU0_DAT6, GPIO1_4, VOU1_DATA6
    reg_write32(IO_CONFIG_REG(13), 0); //VIU0_DAT5, GPIO1_5, VOU1_DATA5
    reg_write32(IO_CONFIG_REG(14), 0); //VIU0_DAT4, GPIO1_6, VOU1_DATA4
    reg_write32(IO_CONFIG_REG(15), 0); //VIU0_DAT3, GPIO1_7, VOU1_DATA3
    reg_write32(IO_CONFIG_REG(16), 0); //VIU0_DAT2, GPIO2_0, VOU1_DATA2
    reg_write32(IO_CONFIG_REG(17), 0); //VIU0_DAT1, GPIO2_1, VOU1_DATA1
    reg_write32(IO_CONFIG_REG(18), 0); //VIU0_DAT0, GPIO2_2, VOU1_DATA0
    reg_write32(IO_CONFIG_REG(19), 0); //VIU1_CLK, GPIO2_3, VOU2_CLK, VIU4_CLK
    reg_write32(IO_CONFIG_REG(20), 1); //VIU1_VS, GPIO2_4, UART2_RXD
    reg_write32(IO_CONFIG_REG(21), 3); //VIU1_HS, GPIO2_5, VOU3_CLK, VIU1_CLKA
    reg_write32(IO_CONFIG_REG(22), 0); //VIU1_DAT15, GPIO2_6, VOU2_DATA7, VIU4_DAT15
    reg_write32(IO_CONFIG_REG(23), 0); //VIU1_DAT14, GPIO2_7, VOU2_DATA6, VIU4_DAT14
    reg_write32(IO_CONFIG_REG(24), 0); //VIU1_DAT13, GPIO3_0, VOU2_DATA5, VIU4_DAT13
    reg_write32(IO_CONFIG_REG(25), 0); //VIU1_DAT12, GPIO3_1, VOU2_DATA4, VIU4_DAT12
    reg_write32(IO_CONFIG_REG(26), 0); //VIU1_DAT11, GPIO3_2, VOU2_DATA3, VIU4_DAT11
    reg_write32(IO_CONFIG_REG(27), 0); //VIU1_DAT10, GPIO3_3, VOU2_DATA2, VIU4_DAT10
    reg_write32(IO_CONFIG_REG(28), 0); //VIU1_DAT9, GPIO3_4, VOU2_DATA1, VIU4_DAT9
    reg_write32(IO_CONFIG_REG(29), 0); //VIU1_DAT8, GPIO3_5, VOU2_DATA0, VIU4_DAT8
    reg_write32(IO_CONFIG_REG(30), 0); //VIU1_DAT7, GPIO3_6, VOU3_DATA7, VIU4_DAT7
    reg_write32(IO_CONFIG_REG(31), 0); //VIU1_DAT6, GPIO3_7, VOU3_DATA6, VIU4_DAT6
    reg_write32(IO_CONFIG_REG(32), 0); //VIU1_DAT5, GPIO4_0, VOU3_DATA5, VIU4_DAT5
    reg_write32(IO_CONFIG_REG(33), 0); //VIU1_DAT4, GPIO4_1, VOU3_DATA4, VIU4_DAT4
    reg_write32(IO_CONFIG_REG(34), 0); //VIU1_DAT3, GPIO4_2, VOU3_DATA3, VIU4_DAT3
    reg_write32(IO_CONFIG_REG(35), 0); //VIU1_DAT2, GPIO4_3, VOU3_DATA2, VIU4_DAT2
    reg_write32(IO_CONFIG_REG(36), 0); //VIU1_DAT1, GPIO4_4, VOU3_DATA1, VIU4_DAT1
    reg_write32(IO_CONFIG_REG(37), 0); //VIU1_DAT0, GPIO4_5, VOU3_DATA0, VIU4_DAT0
    reg_write32(IO_CONFIG_REG(38), 0); //VIU2_CLK, GPIO4_6, VOU4_CLK
    reg_write32(IO_CONFIG_REG(39), 1); //VIU2_VS, GPIO4_7, UART3_TXD
    reg_write32(IO_CONFIG_REG(40), 3); //VIU2_HS, GPIO5_0, VOU5_CLK, VIU2_CLKA
    reg_write32(IO_CONFIG_REG(41), 0); //VIU2_DAT15, GPIO5_1, VOU4_DATA7
    reg_write32(IO_CONFIG_REG(42), 0); //VIU2_DAT14, GPIO5_2, VOU4_DATA6
    reg_write32(IO_CONFIG_REG(43), 0); //VIU2_DAT13, GPIO5_3, VOU4_DATA5
    reg_write32(IO_CONFIG_REG(44), 0); //VIU2_DAT12, GPIO5_4, VOU4_DATA4
    reg_write32(IO_CONFIG_REG(45), 0); //VIU2_DAT11, GPIO5_5, VOU4_DATA3
    reg_write32(IO_CONFIG_REG(46), 0); //VIU2_DAT10, GPIO5_6, VOU4_DATA2
    reg_write32(IO_CONFIG_REG(47), 0); //VIU2_DAT9, GPIO5_7, VOU4_DATA1
    reg_write32(IO_CONFIG_REG(48), 0); //VIU2_DAT8, GPIO6_0, VOU4_DATA0
    reg_write32(IO_CONFIG_REG(49), 0); //VIU2_DAT7, GPIO6_1, VOU5_DATA7
    reg_write32(IO_CONFIG_REG(50), 0); //VIU2_DAT6, GPIO6_2, VOU5_DATA6
    reg_write32(IO_CONFIG_REG(51), 0); //VIU2_DAT5, GPIO6_3, VOU5_DATA5
    reg_write32(IO_CONFIG_REG(52), 0); //VIU2_DAT4, GPIO6_4, VOU5_DATA4
    reg_write32(IO_CONFIG_REG(53), 0); //VIU2_DAT3, GPIO6_5, VOU5_DATA3
    reg_write32(IO_CONFIG_REG(54), 0); //VIU2_DAT2, GPIO6_6, VOU5_DATA2
    reg_write32(IO_CONFIG_REG(55), 0); //VIU2_DAT1, GPIO6_7, VOU5_DATA1
    reg_write32(IO_CONFIG_REG(56), 0); //VIU2_DAT0, GPIO7_0, VOU5_DATA0
    reg_write32(IO_CONFIG_REG(57), 1); //GPIO7_1, VGA_HS
    reg_write32(IO_CONFIG_REG(58), 1); //GPIO7_2, VGA_VS
    reg_write32(IO_CONFIG_REG(59), 0); //VIU3_CLK, GPIO7_3, VOU6_CLK, VOU1120_CLK, SDIO_CCLK_OUT
    reg_write32(IO_CONFIG_REG(60), 1); //VIU3_VS, GPIO7_4, UART3_RXD, VOU1120_VS, SDIO_CARD_POWER_EN
    reg_write32(IO_CONFIG_REG(61), 4); //VIU3_HS, GPIO7_5, VOU7_CLK, VOU1120_HS, VIU3_CLKA
    reg_write32(IO_CONFIG_REG(62), 0); //VIU3_DAT15, GPIO7_6, VOU6_DATA7, VOU1120_DATA15, SDIO_CARD_DETECT
    reg_write32(IO_CONFIG_REG(63), 0); //VIU3_DAT14, GPIO7_7, VOU6_DATA6, VOU1120_DATA14, SDIO_CWPR
    reg_write32(IO_CONFIG_REG(64), 0); //VIU3_DAT13, GPIO8_0, VOU6_DATA5, VOU1120_DATA13, SDIO_CCMD
    reg_write32(IO_CONFIG_REG(65), 0); //VIU3_DAT12, GPIO8_1, VOU6_DATA4, VOU1120_DATA12, SDIO_CDATA0
    reg_write32(IO_CONFIG_REG(66), 0); //VIU3_DAT11, GPIO8_2, VOU6_DATA3, VOU1120_DATA11, SDIO_CDATA1
    reg_write32(IO_CONFIG_REG(67), 0); //VIU3_DAT10, GPIO8_3, VOU6_DATA2, VOU1120_DATA10, SDIO_CDATA2
    reg_write32(IO_CONFIG_REG(68), 0); //VIU3_DAT9, GPIO8_4, VOU6_DATA1, VOU1120_DATA9, SDIO_CDATA3
    reg_write32(IO_CONFIG_REG(69), 0); //VIU3_DAT8, GPIO8_5, VOU6_DATA0, VOU1120_DATA8
    reg_write32(IO_CONFIG_REG(70), 0); //VIU3_DAT7, GPIO8_6, VOU7_DATA7, VOU1120_DATA7
    reg_write32(IO_CONFIG_REG(71), 0); //VIU3_DAT6, GPIO8_7, VOU7_DATA6, VOU1120_DATA6
    reg_write32(IO_CONFIG_REG(72), 0); //VIU3_DAT5, GPIO9_0, VOU7_DATA5, VOU1120_DATA5
    reg_write32(IO_CONFIG_REG(73), 0); //VIU3_DAT4, GPIO9_1, VOU7_DATA4, VOU1120_DATA4
    reg_write32(IO_CONFIG_REG(74), 0); //VIU3_DAT3, GPIO9_2, VOU7_DATA3, VOU1120_DATA3
    reg_write32(IO_CONFIG_REG(75), 0); //VIU3_DAT2, GPIO9_3, VOU7_DATA2, VOU1120_DATA2
    reg_write32(IO_CONFIG_REG(76), 0); //VIU3_DAT1, GPIO9_4, VOU7_DATA1, VOU1120_DATA1
    reg_write32(IO_CONFIG_REG(77), 0); //VIU3_DAT0, GPIO9_5, VOU7_DATA0, VOU1120_DATA0
    reg_write32(IO_CONFIG_REG(78), 0); //GPIO9_6, SIO0_RCLK
    reg_write32(IO_CONFIG_REG(79), 0); //GPIO9_7, SIO0_RFS
    reg_write32(IO_CONFIG_REG(80), 0); //GPIO10_0, SIO0_DIN
    reg_write32(IO_CONFIG_REG(81), 0); //GPIO10_1, SIO1_RCLK
    reg_write32(IO_CONFIG_REG(82), 0); //GPIO10_2, SIO1_RFS
    reg_write32(IO_CONFIG_REG(83), 0); //GPIO10_3, SIO1_DIN
    reg_write32(IO_CONFIG_REG(84), 0); //GPIO10_4, SIO2_RCLK
    reg_write32(IO_CONFIG_REG(85), 0); //GPIO10_5, SIO2_RFS
    reg_write32(IO_CONFIG_REG(86), 0); //GPIO10_6, SIO2_DIN
    reg_write32(IO_CONFIG_REG(87), 1); //GPIO10_7, SIO3_RCLK
    reg_write32(IO_CONFIG_REG(88), 1); //GPIO11_0, SIO3_RFS
    reg_write32(IO_CONFIG_REG(89), 1); //GPIO11_1, SIO3_DIN
    reg_write32(IO_CONFIG_REG(90), 1); //GPIO11_2, SIO4_XCLK
    reg_write32(IO_CONFIG_REG(91), 1); //GPIO11_3, SIO4_XFS
    reg_write32(IO_CONFIG_REG(92), 1); //GPIO11_4, SIO4_RCLK
    reg_write32(IO_CONFIG_REG(93), 1); //GPIO11_5, SIO4_RFS
    reg_write32(IO_CONFIG_REG(94), 1); //GPIO11_6, SIO4_DOUT
    reg_write32(IO_CONFIG_REG(95), 1); //GPIO11_7, SIO4_DIN
    reg_write32(IO_CONFIG_REG(96), 0); //GPIO12_0, SPI_SCLK
    reg_write32(IO_CONFIG_REG(97), 0); //GPIO12_1, SPI_SDO
    reg_write32(IO_CONFIG_REG(98), 0); //GPIO12_2, SPI_SDI
    reg_write32(IO_CONFIG_REG(99), 0); //GPIO12_3, SPI_CSN0
    reg_write32(IO_CONFIG_REG(100), 0); //SPI_CSN6, NF_ECC_TYPE1
    reg_write32(IO_CONFIG_REG(101), 0); //SPI_CSN7, NF_ECC_TYPE2, CLK_TEST_OUT0, CLK_TEST_OUT1, CLK_TEST_OUT2, CLK_TEST_OUT3
    reg_write32(IO_CONFIG_REG(102), 0); //GPIO12_4, I2C_SDA
    reg_write32(IO_CONFIG_REG(103), 0); //GPIO12_5, I2C_SCL
    reg_write32(IO_CONFIG_REG(104), 0); //GPIO12_6, UART1_RTSN
    reg_write32(IO_CONFIG_REG(105), 1); //GPIO12_7, UART1_RXD
    reg_write32(IO_CONFIG_REG(106), 1); //GPIO13_0, UART1_TXD
    reg_write32(IO_CONFIG_REG(107), 0); //GPIO13_1, UART1_CTSN
    reg_write32(IO_CONFIG_REG(108), 0); //RGMII0_TXCK, GPIO13_2
    reg_write32(IO_CONFIG_REG(109), 1); //GPIO13_3, RGMII0_CRS, RGMII0_RXER
    reg_write32(IO_CONFIG_REG(110), 1); //GPIO13_4, RGMII0_COL, RGMII0_TXER
    reg_write32(IO_CONFIG_REG(111), 0); //GPIO13_5, RGMII1_RXDV
    reg_write32(IO_CONFIG_REG(112), 0); //GPIO13_6, RGMII1_RXD3
    reg_write32(IO_CONFIG_REG(113), 0); //GPIO13_7, RGMII1_RXD2
    reg_write32(IO_CONFIG_REG(114), 0); //GPIO14_0, RGMII1_RXD1
    reg_write32(IO_CONFIG_REG(115), 0); //GPIO14_1, RGMII1_RXD0
    reg_write32(IO_CONFIG_REG(116), 0); //GPIO14_2, RGMII1_RXCK
    reg_write32(IO_CONFIG_REG(117), 0); //GPIO14_3, RGMII1_TXEN
    reg_write32(IO_CONFIG_REG(118), 0); //GPIO14_4, RGMII1_TXD3
    reg_write32(IO_CONFIG_REG(119), 0); //GPIO14_5, RGMII1_TXD2
    reg_write32(IO_CONFIG_REG(120), 0); //GPIO14_6, RGMII1_TXD1
    reg_write32(IO_CONFIG_REG(121), 0); //PLL_TEST_OUT0, RGMII1_TXD0, PLL_TEST_OUT1, PLL_TEST_OUT2, PLL_TEST_OUT3
    reg_write32(IO_CONFIG_REG(122), 0); //GPIO15_0, RGMII1_TXCK
    reg_write32(IO_CONFIG_REG(123), 0); //GPIO15_1, RGMII1_TXCKOUT
    reg_write32(IO_CONFIG_REG(124), 0); //GPIO15_2, RGMII1_CRS, RGMII1_RXER
    reg_write32(IO_CONFIG_REG(125), 0); //GPIO15_3, RGMII1_COL, RGMII1_TXER
    reg_write32(IO_CONFIG_REG(126), 0); //IR_IN, GPIO15_4
    reg_write32(IO_CONFIG_REG(127), 1); //NF_DQ0, GPIO15_5
    reg_write32(IO_CONFIG_REG(128), 1); //NF_DQ1, GPIO15_6
    reg_write32(IO_CONFIG_REG(129), 1); //NF_DQ2, GPIO15_7
    reg_write32(IO_CONFIG_REG(130), 1); //NF_DQ3, GPIO16_0
    reg_write32(IO_CONFIG_REG(131), 1); //NF_DQ4, GPIO16_1
    reg_write32(IO_CONFIG_REG(132), 1); //NF_DQ5, GPIO16_2
    reg_write32(IO_CONFIG_REG(133), 1); //NF_DQ6, GPIO16_3
    reg_write32(IO_CONFIG_REG(134), 1); //NF_DQ7, GPIO16_4
    reg_write32(IO_CONFIG_REG(135), 1); //NF_RDY0, GPIO16_5
    reg_write32(IO_CONFIG_REG(136), 1); //NF_RDY1, GPIO16_6
    reg_write32(IO_CONFIG_REG(137), 0); //SFC_DIO, GPIO16_7
    reg_write32(IO_CONFIG_REG(138), 0); //SFC_WP_IO2, GPIO17_0
    reg_write32(IO_CONFIG_REG(139), 0); //SFC_D0I, GPIO17_1
    reg_write32(IO_CONFIG_REG(140), 0); //SFC_HOLD_IO3, GPIO17_2
    reg_write32(IO_CONFIG_REG(141), 0); //GPIO17_3, USB0_OVRCUR
    reg_write32(IO_CONFIG_REG(142), 0); //GPIO17_4, USB0_PWREN
    reg_write32(IO_CONFIG_REG(143), 0); //GPIO17_5, USB1_OVRCUR
    reg_write32(IO_CONFIG_REG(144), 0); //GPIO17_6, USB1_PWREN
    reg_write32(IO_CONFIG_REG(145), 1); //GPIO17_7, HDMI_HOTPLUG
    reg_write32(IO_CONFIG_REG(146), 1); //GPIO18_0, HDMI_CEC
    reg_write32(IO_CONFIG_REG(147), 1); //GPIO18_1, HDMI_SDA
    reg_write32(IO_CONFIG_REG(148), 1); //GPIO18_2, HDMI_SCL
    reg_write32(IO_CONFIG_REG(149), 1); //GPIO18_3, SATA_LED_N0
    reg_write32(IO_CONFIG_REG(150), 1); //GPIO18_4, SATA_LED_N1
}
ngswfx

ngswfx

2个粉丝

55

问答

1

专栏

40

资料

ngswfx 2016-07-21 06:44:55
认可0
本帖最后由 ngswfx 于 2016-7-21 07:24 编辑

[quote][url=forum.php?mod=redirect&goto=findpost&pid=34454&ptid=12020]goo635 发表于 2016-7-21 06:17[/url]
static void gpio_mode_conf(void)
{
    reg_write32(IO_CONFIG_REG(0), 0); //VIU0_CLK, GPIO0_0, VO ...[/quote]


/////看VIU0-VIU3配置都挺有规律。如果能把XM的程序跑起来，读一读对比一下，估计比较好找原因点。

我手上有一个3520D V300 的6124 4路的估计是1080P的，配置应该和你这个完全不同，应该是16bit数据在输入。最近太忙，我还没调试过。
goo635

goo635

0个粉丝

17

问答

0

专栏

2

资料

goo635 2016-07-21 08:27:09
认可0
[quote][url=forum.php?mod=redirect&goto=findpost&pid=34455&ptid=12020]ngswfx 发表于 2016-7-21 06:44[/url]
/////看VIU0-VIU3配置都挺有规律。如果能把XM的程序跑起来，读一读对比一下，估计比较好找原因点。
...[/quote]

雄迈的程序没有源码，vi 显示的配置是一样的。。。
添加附件 添加网盘链接
或将文件直接拖到这里
悬赏：
E币
网盘
* 网盘链接：
* 提取码：
悬赏：
E币

Markdown 语法

  • 加粗**内容**
  • 斜体*内容*
  • 删除线~~内容~~
  • 引用> 引用内容
  • 代码`代码`
  • 代码块```编程语言↵代码```
  • 链接[链接标题](url)
  • 无序列表- 内容
  • 有序列表1. 内容
  • 缩进内容
  • 图片![alt](url)
+ 添加网盘链接/附件

Markdown 语法

  • 加粗**内容**
  • 斜体*内容*
  • 删除线~~内容~~
  • 引用> 引用内容
  • 代码`代码`
  • 代码块```编程语言↵代码```
  • 链接[链接标题](url)
  • 无序列表- 内容
  • 有序列表1. 内容
  • 缩进内容
  • 图片![alt](url)
相关问答
无更多相似问答 去提问
易百纳技术社区
点击登录
-- 积分
-- E币
提问
—
收益
—
被采纳
—
我要提问
社区问答
悬赏问答
举报反馈

举报类型

  • 内容涉黄/赌/毒
  • 内容侵权/抄袭
  • 政治相关
  • 涉嫌广告
  • 侮辱谩骂
  • 其他

详细说明

提醒
你的问题还没有最佳答案，是否结题，结题后将扣除20%的悬赏金
取消
确认
提醒
你的问题还没有最佳答案，是否结题，结题后将根据回答情况扣除相应悬赏金（1回答=1E币）
取消
确认
易百纳技术社区