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Hi3518E JTAG链接提示 Unable to halt CPU core
自己按照Hi官方硬件电路图进行裁剪,做了一块基于Hi3518E的摄像头控制器。第一次下载uboot,使用JTAG链接CPU,reset后提示Unable to halt CPU core。在网上查资料说是FLASH未复位,导致CPU忙,无法被挂起。但是我使用的SPI flash根本没有reset管脚。认真检查了电路,并对照硬件开发手册分析,是否是如下原因:
目前电路图的链接将POR_SEL串联下拉电阻至GND,即选择CPU内部复位模式,对外部复位不响应。因此上电后CPU自行进行内部复位,之后一直在工作,不响应由JTAG发出的外部复位命令,造成仿真器认为CPU无法被挂起。
另外,想请问一下,在JTAG模式下,3518E的复位电路应如何设计,其外设(如Sia9022)的复位电路又该如何链接呢?
目前电路图的链接将POR_SEL串联下拉电阻至GND,即选择CPU内部复位模式,对外部复位不响应。因此上电后CPU自行进行内部复位,之后一直在工作,不响应由JTAG发出的外部复位命令,造成仿真器认为CPU无法被挂起。
另外,想请问一下,在JTAG模式下,3518E的复位电路应如何设计,其外设(如Sia9022)的复位电路又该如何链接呢?
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